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実装コストを実際に下げる6つのてこ

実装コストは、誰かが価格交渉を始めるよりずっと前に、設計と発注で決まっています。

Hitech Circuits エンジニアリングデスク

中国・深セン · PCB製造・実装

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技術監修: プロセス数値は公開中の能力表と照合済みです。

プリント基板実装コストを下げる6つの実務的な手段

コストが決まる場所

見積りを交渉する時点で、実装コストの大半はすでに固まっています。パネル、BOM、試験戦略、ロットサイズで決まっているのです。以下の6つのてこは、時間単価ではなく、これらの入力条件を動かします。

1. パネルの取り数

印刷、搭載、リフローはいずれも1パスあたりのコストで、1枚のパネルは複数の基板を1パスで通します。パネルあたりの基板数が増えれば、基板あたりのパス数は減ります。

実務的な手は3つです。機構設計が許す範囲で外形を矩形に保つこと、他の案件と共有できる標準のパネルサイズを使うこと、そして図面で配列を固定せず製造側に提案させることです。

2. BOM の集約

品目の1つ1つが、フィーダーと段取り確認と発注作業になります。1本にまとめられる2つの抵抗値、1つ上の標準値にできる2つのコンデンサ耐圧、製品の他の箇所ですでに使っているコネクタ——どれも段取りを減らします。

限界はエンジニアリングにあります。値を集約するのは無償ですが、公差を変えるのは無償ではありません。

3. 層数と銅厚

配線を詰めた少ない層が、余裕のある多い層に勝つことがあります。配線がマイクロビアを必要とする場合は逆になります。厚銅の基板では、銅をすべての層ではなく電流が流れる層だけに置くことが、たいてい最大の単一の削減になります。

4. 試験戦略

治具を使うインサーキット検査、フライングプローブ、機能試験のみ。この選択は品質の判断ではなく、コストとリスクの判断です。フライングプローブは低量で治具代を回避し、設計が繰り返し流れるようになると治具が安くなり、機能試験はどちらも捕れない不良を捕まえます。

5. 発注量とまとめ方

段取りの償却は大きなロットに有利で、在庫の保管コストは小さなロットに有利です。有用な問いは、1回の生産で年間需要のどれだけを、在庫を負債にせずに賄えるか、そしてその先までコミットできるほど設計が安定しているかです。

6. 納期

特急の生産は、ラインの順序変更、速達輸送、残業のコストを払います。中量で標準の 4〜10日 を取る日程は、48時間の約束に比べて、速さ以外に何も生まない割増を消します。

犠牲にすべきでないもの

取り戻せる以上に高くつく削減があります。

  • ペーストとプロファイルの近道。安いペーストや速いプロファイルは、ボイド、部品の片浮き、市場からの返品として現れます。
  • 初品検査の省略。段取りの誤りがロット全体に繰り返されます。
  • 未承認の代替品。電気的に似ていても機械的に異なる部品は、実装や温度サイクルで壊れます。
  • 塗布前の洗浄省略。コーティングが残渣を閉じ込め、見た目の問題をリークに変えます。

実務の作業順

  1. 配列とパネルを固める。
  2. 設計チームと BOM を集約する。
  3. 銅厚と層数を、習慣ではなく配線に合わせて選ぶ。
  4. 市場故障のコストから試験戦略を決める。
  5. そのうえでロットサイズと納期を選ぶ。

一式のデータがそろっていれば BOM の見積りは24時間以内に返り、試作は1〜3日で流れます。量産を決める前に、この6つのてこを試すには十分です。工程限界はPCBA 製造のページに、基板側のコスト要因はリジッド基板のコスト要因にまとめてあります。

技術仕様

小ロットの範囲
6,000 枚未満のご注文
実装能力
SMT ライン4本・1日 600万チップ
見積り
BOM 見積りは24時間以内
納期
試作1〜3日・中量4〜10日
ステンシル
4時間以内に製作・納品

よくあるご質問

  • 発注量を増やせば単価は必ず下がりますか。

    あるところまでは下がります。段取り、ステンシル、プログラミングはロットで償却されるため、単価は最初に急に下がり、その後は平らになります。それ以上は在庫です。コストを抱え、棚寿命を消費し、出荷前に廃番になることもあります。最も安い数量は、需要に緩衝分を加えた量であり、価格表の最大の段ではありません。

  • 試験範囲を削るのは安全な削減ですか。

    コストを移すだけで、消すことはできません。インサーキット検査を削れば不良は機能試験へ移り、機能試験を削れば不良は顧客へ移ります。適切な水準は、その製品での市場故障のコストから決まります。2 ユーロのセンサー基板と 200 ユーロのコントローラに、同じ試験戦略は要りません。

  • パネルの取り数はどうやって実装コストを下げるのですか。

    搭載、印刷、リフローは1パスごとに課金され、パネルは1パスで複数の基板を運びます。パネルに多く取れるレイアウトは基板あたりのパス数を減らし、パネル面積を無駄にする形状は、その無駄を毎ロット支払うことになります。基板サイズと外形は、機械図面だけの話ではなく、コストの議論に入れるべき項目です。

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